考虑以下电路，其初始状态Q0 = Q1 =0。D触发器为正沿触发，建立时间为20纳秒，保持时间为0。
考虑下面的X和C时序图；时钟周期C <= 40纳秒。 Y的正确图是哪一个? 
(一)
(B) b
(C) c
(D) d答案： (A)
说明：给出建立时间和保持时间只是为了确保边缘触发正常工作。
- 由于时钟是由上升沿触发的，因此第一个上升沿触发是：由于X为0，所以输出将为0。而且，Q0和Q0’分别为0和1。
- 现在，在第二步中，由于触发器的建立时间为20 ns，时钟周期≥40 ns，因此Q0’将为1。
因此，第二个上升沿触发：由于X为1且Q0’为1，因此输出为1。 - 现在，Q0’将变为0，但是由于触发器被上升沿触发，输出Y不会改变。
第三个上升沿触发：由于X为1且Q0’为0，因此输出为0。 - 现在，输出永远不会变回1，因为Q0’始终为0，而当Q0’最终变为1时，X为0。
因此，选项(A)是正确的。
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